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职位描述
其它兼职类
职位类别: 其它兼职类
职责描述: 1.RTL代码的设计/开发/维护 SoC 子模块。 2.建立test bench测试环境给该模块。 3.在交付IP或模块前的检测 (Lint, Spyglass, CDC, synthesis, STA, formal check, 覆盖率)。 4.撰写绘制该详细设计架构图及其技术规格书。 5.与验证工程师或韧体工程师合作开发验证方案来验证该IP或模块。 6.在FPGA进行验证或除错,从RTL的验证,合成,时续分析等参与SoC/ASIC的开发。 7.SoC整合功能性验证。 任职要求: 1.本科以上相关专业。 2.英语技能必须通过CET-4等级或更高。 3.至少5年在业界SoC/ASIC前端设计相关经验。 4.Verilog RTL撰写及验证和除错技巧。 5.有撰写过模块或者是IP,并且为其建立测试环境及为其撰写测试用意。 6.为该设计做FPGA的功能性验证。 7.有Lint, 覆盖率, Verdi, C/C++ 的相关经验。 8.必须熟知AMBA AXI,AHB,APB总线协议。 9.良好的英文阅读能力。 10.ASIC 设计流程及流片流程。 11.后仿真的经验。 如果有下列知识或技能优先: 1.System Verilog 2.TCL, Perl, makefile 3.SSD/Flash/NVMe/PCIe/DDR/BCH/LDPC相关经验 4.VCS或NCV 5.SoC合成,约束,整合 6.SoC时续分析及时续约束 7.Clock/Reset/DFT/UPF 8.SoC架构关念
- 年龄要求: 不限
- 语言要求:不限
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企业简介
深圳大普微电子科技有限公司
- 行业: 电子/半导体/集成电路
- 规模: 若干人
- 性质: 其他
- 当前职位: 芯片资深数字设计工程师
深圳大普微电子科技有限公司成立于2016年4月,是深圳市高层次人才团队项目企业,先后获得深圳市政府最高科技创新资金支持和国家财政部基金A轮融资。 公司致力于打造世界首创的数据存储处理器芯片(Data-storage Processing Unit简称DPU)及智能SSD产品,突破计算与存储分离的传统冯诺依曼式体系结构,创新Processing In Storage(PIS)技术,研究开发基于机器学习的智能存储优化与控制技术,有效增强SSD产品性能、延长存储器寿命、提高计算系统整体性能。DPU是计算机、存储、集成电路、人工智能、信息安全等多学科交叉领域的一项重大技术创新,填补了国际上智能存储技术的空白。 公司拥有全球领先的核心技术,已获得国内外发明专利近50项。公司曾荣获2017TRACKER 年度科技创新潜力奖,2017 深圳创新榜“年度创新成长企业”奖,2017 世界互联网大会“年度45 强企业”奖。 公司拥有世界一流的研发团队,大普微拥有近80名团队成员,其中有7位教授,11位博士,40位硕士。
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